Marvell支持下一代数据中心及汽车 AI 加速器 ASIC保险座
发布时间:2022-09-20 10:34:58
Marvell支持下一代数据中心及汽车 AI 加速器 ASIC保健护具
为业界首款 每秒千万亿次运算(peta OP/s AI) 芯片加速器提供发展动力
Marvell今日宣布,其定制化专用集成电路 (ASIC) 产品完全有能力为数据中心和汽车市场提供下一代人工智能 (AI) 加速器解决方案。
Marvell的定制化 ASIC 产品为 AI 及机器学习应用提供了不同功能,包括具备领先密度和性能的 SRAM、最高性能的 SerDes 和全系列预认证的高带宽内存接口。它同时拥有最新的 PCI-Express (PCIe) 和 IO 技术,包括定制的多抽头、多级、高驱动的时钟元件。 该 IP 由Marvell设计并通过资格预认证,以实现卓越的性能与可靠性。
Marvell的 ASIC 产品通过交钥匙设计和验证以及定制网状互联芯片通信,可确保以最快的速度推向市场。此外鞋套,Marvell的 ASIC 方法具有用于降低功耗的自适应电压供应,以及定制的分层测试方法、逻辑冗余和用于增强可靠性的自定制存储器 BIST 解决方案。 Marvell支持多种 ASIC 参与模式,从提供完全交钥匙产品到进行客户拥有的物理设计,可供客户选择来优化其差异化模块。 无论客户采用何种参与模式,从物理设计、测试设计、功率和时序优化到仿真、ATPG 和制造测试、原型制作再到生命周期始末的可靠性所有权,Marvell都会提供合乒乓球馆格的整套流程。
Marvell正与许多数据中心和汽车制造商合作,以开发定制的 AI ASIC。Gr拉网头oq 利用其 ASIC 产品拓展了Marvell的创新公司客户名单,正致力于创建业内首个每秒 可运算千万亿次的(peta operations per second, POP/s) AI 加速芯片。
Groq 首席执行官 Jonathan Ross 表示:“我们与Marvell的 ASIC 合作取得了非比寻常的成果。我们知道,想要摆脱 FPGA、CPU 和 GPU 等传统架构的束缚,并打造业界前所未见的革命性产品,需要一个独特的合作伙伴。Marvell助力了我们首款也是唯一一款支持每秒 peta 运算的处理器愿景,并使之成为现实。他们是为数不多的既能创新又能实现创新的 ASIC 团队之一。”
Marvell ASIC 事业部总经理 Kevin O'Buckley 表示:“这些最新的定制 化ASIC 设计脱胎于超过 25 年的 ASIC 设计经验和领先能力,最终实现了最复杂的加速器、存储和车载解决方案。通过采用独特的 IP、设计、布局和测试流程,我们能够与客户合作,创造业界最复杂、性能最高的 AI 加速器芯片,并迅速投放市场。”
Marvell的设计合作伙伴关系的关键因素包括具有抽象和分布式计算的分层设计实施、超稳健的配电和电源完整性建模、具有逻辑冗余的定制分层测试方法、用于系统和测试时钟的全芯片实用的倾斜结构时钟网络、一个设计分析仪表盘,以及最终网络列表在 85 天内即可完成。
有关 Marvell 独有的定制化 ASIC 产品的更多信息,请参见此处。
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Marvell的定制化 ASIC 产品为 AI 及机器学习应用提供了不同功能,包括具备领先密度和性能的 SRAM、最高性能的 SerDes 和全系列预认证的高带宽内存接口。它同时拥有最新的 PCI-Express (PCIe) 和 IO 技术,包括定制的多抽头、多级、高驱动的时钟元件。 该 IP 由Marvell设计并通过资格预认证,以实现卓越的性能与可靠性。
Marvell的 ASIC 产品通过交钥匙设计和验证以及定制网状互联芯片通信,可确保以最快的速度推向市场。此外鞋套,Marvell的 ASIC 方法具有用于降低功耗的自适应电压供应,以及定制的分层测试方法、逻辑冗余和用于增强可靠性的自定制存储器 BIST 解决方案。 Marvell支持多种 ASIC 参与模式,从提供完全交钥匙产品到进行客户拥有的物理设计,可供客户选择来优化其差异化模块。 无论客户采用何种参与模式,从物理设计、测试设计、功率和时序优化到仿真、ATPG 和制造测试、原型制作再到生命周期始末的可靠性所有权,Marvell都会提供合乒乓球馆格的整套流程。
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Groq 首席执行官 Jonathan Ross 表示:“我们与Marvell的 ASIC 合作取得了非比寻常的成果。我们知道,想要摆脱 FPGA、CPU 和 GPU 等传统架构的束缚,并打造业界前所未见的革命性产品,需要一个独特的合作伙伴。Marvell助力了我们首款也是唯一一款支持每秒 peta 运算的处理器愿景,并使之成为现实。他们是为数不多的既能创新又能实现创新的 ASIC 团队之一。”
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Marvell的设计合作伙伴关系的关键因素包括具有抽象和分布式计算的分层设计实施、超稳健的配电和电源完整性建模、具有逻辑冗余的定制分层测试方法、用于系统和测试时钟的全芯片实用的倾斜结构时钟网络、一个设计分析仪表盘,以及最终网络列表在 85 天内即可完成。
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